本答复记录提供一个可供下载的 PDF 格式的 MIG 7 系列 DDR3/DDR2 硬件调试指南,以加强其易用性。
答复记录以 Web 方式提供,且内容会随新信息的出现而经常更新。访问此答复记录,以获取最新的 PDF 版本。
注意:从 MIG 7 系列 v1.9 版本开始,此调试内容已被移至 7 系列 FPGA 存储器接口解决方案用户指南。 敬请参考 ''调试 DDR3/DDR2 设计'' 部分。
注意: 本答复记录是 Xilinx MIG 解决方案中心的一部分 (Xilinx 答复 34243)。
Xilinx MIG 解决方案中心可解决所有与 MIG 相关的问题。
无论您是要使用 MIG 来进行新设计还是要解决问题,请使用 MIG 解决方案中心来指导您获取相应的信息。
请下载附在本解决方案末尾的 7 系列 MIG DDR3/DDR2 硬件调试指南 (PDF)。
此文档介绍了与采用 7 系列 MIG DDR3 SDRAM 内核的设计有关的校正失败与数据错误的调试技术。
当调试校正失败和数据错误时可提供需要在 ChipScope Pro 工具中捕捉的信号完整列表。
ChipScope Pro 工具屏幕截图演示了如何分析这些信号并建立潜在问题根源的理论。
请使用附在本解决方案末尾的 7 系列校正结果电子数据表 (ar43879_7series_ddr3_cal_results.xlsx) ,以获取校正结果。
修订历史:
03/11/2014 - 更新接头收集电子表至最新校准算法
04/29/2013 - 新增说明-调试内容现为用户指南的一部分。
10/12/2012 - 更新附件。
10/05/2012 - 添加 PRBS 读校准、流量生成器数据错误调试以及 Window 裕量检查。
07/19/2012 - 为数据错误调试部分添加内容。
06/04/2012 - 更新的 CK 和 DQS 布线匹配指南,并向定位的数据错误部分添加内容。
05/08/2012——初始版本.
文件名 | 文件大小 | File Type |
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7 Series MIG DDR3 - Hardware Debug Guide | 2 MB | |
7series_ddr3_cal_results.xlsx | 25 KB | XLSX |
7series_ddr3_cal_results_labtools.xlsx | 26 KB | XLSX |
7series_ddr3_cal_results.zip | 17 KB | ZIP |
7series_ddr3_cal_results_labtools.zip | 18 KB | ZIP |
Answer Number | 问答标题 | 问题版本 | 已解决问题的版本 |
---|---|---|---|
46227 | MIG 7 Series Solution Center - Top Issues | N/A | N/A |
51315 | Xilinx MIG 7 Series Solution Center Design Assistant - Hardware usage and debug | N/A | N/A |
35094 | MIG Virtex-6 and 7 Series DDR3 - Write Leveling | N/A | N/A |
34923 | MIG Virtex-6 DDR2/DDR3 Solution Center Design Assistant - Design Signal and Parameter Descriptions | N/A | N/A |
51914 | MIG 7 Series DDR3/DDR2 - Generated RTL Parameter, UCF Constraint, and Signal Descriptions | N/A | N/A |
51954 | MIG 7 Series DDR2/DDR3 - PHY Initialization and Calibration | N/A | N/A |
34359 | MIG Virtex-6 and 7 Series DDR3 - Jedec Specification - Multi-Purpose Register | N/A | N/A |
52808 | KC705 Example Designs - MIG Design Files enhanced window margining | N/A | N/A |
Answer Number | 问答标题 | 问题版本 | 已解决问题的版本 |
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51667 | Xilinx MIG 7 系列解决方案中心设计助手 - 仿真调试 | N/A | N/A |