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AR# 54525

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LogiCORE IP Image Enhancement - 面向 Vivado 2013.1 和更新工具版本的发布说明和已知问题

描述

本答案记录不仅包含 Image Enhancement LogiCORE IP 的发布说明及已知问题，而且还包括以下内容：

  • 一般信息
  • 已知和已解决的问题
  • 修订历史

发布说明和已知问题答复记录面向在 Vivado 2013.1 和更新工具版 中生成的核。

敬请参考 XTP025 -面向已知问题日志和 ISE 技术支持信息的 IP 发布说明指南 。

Image Enhancement LogiCORE IP 页面：

//m.akhomesold.com/content/xilinx/zh/products/intellectual-property/ef-di-img-enhance.html

注意：: 该内核以前叫图像边缘增强内核。

解决方案

在 2019.1 停用，不建议用于新设计。

查看 IP 页面，搜索所提供的 Xilinx IP 和第三方合作伙伴 IP。

一般信息

支持的器件可在以下位置找到:

如需查看新特性列表和所有版本添加的器件支持，请参见 Vivado 设计工具中提供该核的 Change Log 文件。

版本表

此表将内核版本关联至首个包含该表的 Vivado 设计工具发布版本。

内核
版本		Vivado 工具
版本
v8.0 (Rev. 15)2018.3(Xilinx Answer 71806)
v8.0 (Rev. 14)2017.4(Xilinx Answer 70386)
v8.0 (Rev. 13)2017.3
v8.0 (Rev. 12)2016.4
v8.0 (Rev. 11)
v8.0 (Rev. 10)
v8.0 (Rev. 9)
v8.0 (Rev. 8)
v8.0 (Rev. 7)
v8.0 (Rev. 6)
v8.0 (Rev. 5)
v8.0 (Rev. 4)
v8.0 (Rev. 3)2014.1
v8.0 (Rev. 2)2013.4
v8.0 (Rev. 1)2013.3
v8.02013.2
v7.02013.1


通用指南

下表提供使用 Image Enhancement LoGiCORE IP 的通用指南答复记录。

答复记录标题
N/AN/A

已知和已解决的问题

下表提供   LogiCORE IP Image Enhancement 核的已知问题，始于 Vivado 2013.1 中首先推出的 v7.0。

注意："找到的版本" 列出了首次发现问题的版本。

该问题可能也出现于较早版本，但未对较早版本进行特定测试。

答复记录标题发现问题的版本已解决的问题
(Xilinx Answer 61998)各种内核参数，哪些值是法定的？v8.0N/A
(Xilinx Answer 60173)为什么图像增强内核在通过 AXI4-Lite 接口改变列数后，会将数据输出到错误的列中？v8.0N/A
(Xilinx 答复 57773)为什么当使用视频 IP 中的 TEST_PATTERN 或 BYPASS 选项时 TREADY 延迟，生成时启用 Include Debug 功能选项？v5.01.av8.0 (Rev. 3)
(Xilinx 答复 52215)Why does my core fail timing with a Critical Warning? v5.01.av8.0 (Rev. 1)
(Xilinx 答复 56274)Vivado 2013.2 Multimedia Video and Imaging - How do I properly constrain the Video IP in my design? v7.0v8.0 (Rev. 1)
(Xilinx 答复 55980)Why do I see write failures on the AXI4-Lite bus, when the AXI4-Stream clock is at a different frequency than the AXI4-Lite interface clock? v7.0v7.0 (Rev. 1)


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修订历史:

01/04/2019新增的 v8.0 (Rev. 4 -15) 增加了过时的链路和论坛链路
2014/9/10新增了（Xilinx 答复 61998）。
10/23/2013版本表、（Xilinx 答复 57773）和更新的、2013.3 的已知问题及已解决问题表中新增了 v8.0 (Rev. 1)。
06/19/2013版本表、（Xilinx 答复 56274）以及（Xilinx 答复 55980）中新增了 v8.0
04/03/2013——初始版本

链接问答记录

主要问答记录

Answer Number 问答标题 问题版本 已解决问题的版本
56852 Xilinx Multimedia, Video and Imaging Solution Center - Top Issues N/A N/A

子答复记录

Answer Number 问答标题 问题版本 已解决问题的版本
52215 14.3 / 2012.2 Video IP - Why does my core fail timing with a critical warning? N/A N/A
56274 Vivado 2013.2 Multimedia Video and Imaging - How do I properly constrain the Video IP in my design? N/A N/A
55980 LogiCORE Video Timing Controller v5.01.a - Why do I see write failures on the AXI4-Lite bus, when the AXI4-Stream clock is at a different frequency than the AXI4-Lite interface clock? N/A N/A
57773 Vivado 2013.2 Multimedia Video and Imaging - Why does the TREADY stall when using the TEST_PATTERN or BYPASS options available in some of the Video IP when the Include Debug Features option is enabled at generation? N/A N/A
61998 LogiCORE IP Image Enhancement v8.0 - What values are legal for various core parameters? N/A N/A

相关答复记录

Answer Number 问答标题 问题版本 已解决问题的版本
61625 Video IP Example Design Landing Page N/A N/A
AR# 54525
日期 01/30/2019
状态 Active
Type 版本说明
Tools
IP
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